Synopsys VC Static Tools为用户提供静态和集成的环境，IC设计验证软件，在设计早期轻松分析、检查RTL代码，不需要您有复杂的操作和配置，立即读取、查询您的设计以及在设计中管理 Blackbox 模块，它属于Synopsys Verification Continuum平台，基于业界领先的硬件和软件验证工具构建，提供新的本地集成，使设计人员能够加速验证关闭。
功能特色
1、作为复杂集成电路（IC）设计领域的技术领导者，Synopsys， Inc.推出了VC Static Tools vS-2021.09，作为Synopsys Verification Continuum平台的一部分。
2、这些工具使设计师和验证工程师能够在设计流程的早期阶段快速分析和检查RTL代码，而无需复杂的配置，测试台或输入驱动程序。
3、Synopsys Verification Continuum 平台基于设计验证领域领先的硬件和软件工具，提供了新的本地集成，使设计师能够加快实现最终验证的过程。
4、Synopsys 的 VC Formal、VC LP、VC SpyGlass、SpyGlass 和 Timing Constraints Manager 工具使设计师和验证工程师能够在设计流程的早期阶段快速分析和检查 RTL 代码，而无需复杂的配置、测试台或输入驱动程序。
5、这种方法可以在模拟之前检测和修复许多错误，从而使模拟更快，更高效，并减少成本，时间和总体努力。
6、VC SpyGlass和VC Formal解决方案建立在新一代数据库和引擎之上，以提供验证最大和最复杂设计所需的容量和效率。
7、此外，VC Formal、VC SpyGlass 和 VC LP 工具具有与 Synopsys Design Compiler 相似的集成设计读取支持和协调的用户界面（包括 Tcl 支持），可实现相同的体验、快速采用、易用性和有效的除错。
8、Synopsys VC Static Tools功能：
读取和查询设计（例如：结构处理和RTL字符串）
在设计中管理 Blackbox 模块
在各种设计验证工具之间提供静态和集成的环境
闪电小编说明：
友好的工作环境，更高效轻松完成任务，并减少成本和时间上的耗费，针对复杂的设计和工作也能很好的完成。
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